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    高速PCB設計中什么時候需要阻抗匹配

    • 發表時間:2020-06-12 15:43:09
    • 作者:下單文員
    • 來源:新聞中心
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      阻抗匹配是指在能量傳輸時,要求負載阻抗要和傳輸線的特征阻抗相等,此時的傳輸不會產生反射,這表明所有能量都被負載吸收了。反之則在傳輸中有能量損失。在高速PCB設計中,阻抗的匹配與否關系到信號的質量優劣。
    高速PCB設計中什么時候需要阻抗匹配

      高速PCB設計中的阻抗匹配

      不主要看頻率,而關鍵是看信號的邊沿陡峭程度,即信號的上升/下降時間,一般認為如果信號的上升/下降時間(按10%~90%計)小于6倍導線延時,就是高速信號,必須注意阻抗匹配的問題。導線延時一般取值為150ps/inch。

      信號沿傳輸線傳播過程當中,如果傳輸線上各處具有一致的信號傳播速度,并且單位長度上的電容也一樣,那么信號在傳播過程中總是看到完全一致的瞬間阻抗。由于在整個傳輸線上阻抗維持恒定不變,我們給出一個特定的名稱,來表示特定的傳輸線的這種特征或者是特性,稱之為該傳輸線的特征阻抗。

      特征阻抗是指信號沿傳輸線傳播時,信號看到的瞬間阻抗的值。特征阻抗與PCB導線所在的板層、PCB所用的材質(介電常數)、走線寬度、導線與平面的距離等因素有關,與走線長度無關。特征阻抗可以使用軟件計算。高速PCB布線中,一般把數字信號的走線阻抗設計為50歐姆,這是個大約的數字。一般規定同軸電纜基帶50歐姆,頻帶75歐姆,對絞線(差分)為100歐姆。

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    標題:高速PCB設計中什么時候需要阻抗匹配 
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